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CEVA推出高能效1GHzDSP内核CEVAX1643万芳

发布时间:2020-02-14 11:43:53 阅读: 来源:插件机厂家

CEVA推出高能效1 GHz DSP内核CEVA-X1643 - 单片机/处理器 - 电子工程网

CEVA-X1643 DSP具有结合了单指令多数据(Single Instruction Multiple Data, SIMD)能力的超长指令字(Very Long Instruction Word, VLIW)架构,其32位编程模式支持高水平并行处理方式,每周期可处理多达8条指令,或每周期实现16个SIMD操作。CEVA-X1643借助经平衡优化的管线系统,能够在采用40 nm工艺节点的芯片中实现超过1 GHz的运行速度。

内置标准AXI总线桥

CEVA-X1643备有基于高性能先进可扩展接口(Advanced eXtensible Interface, AXI)的存储器子系统支持;可配置AXI总线带宽、并行读/写操作、读后写入(RAW)操作和其它先进功能,确保在实际系统中达到目标性能。行业标准系统总线配合完全高速缓存的CEVA-X处理器,确保实现高性能、短设计周期,以及简便地集成到目标SoC。

高能效功耗控制

CEVA-X1643 DSP内核包含一个创新的功率调节单元(Power Scaling Unit, PSU),可提供针对动态功耗和漏电功耗的先进功率管理功能。该内核支持多个时钟域以及主要功能单元相关的多功率域功耗管理控制功能,如DSP内核,指令及高速数据缓存。此PSU支持从完全工作、调试旁路、内存维持,到完全电源关断(power shut-off, PSO)等多种工作模式,且AXI全双工总线亦提供低功耗特性,可在无数据流时关断。在能源意识日益深入人心并成为产品关键因素的大环境下,CEVA-X1643可为电池供电或固定设备提供显著的功耗控制优势。

从基于TI C6x的设计无缝迁移

CEVA-X1643支持从现有DSP芯片轻易迁移至可综合DSP内核并集成至客户SoC设计中。它结合了编译器友好(complier-friendly)的8路VLIW和SIMD架构,一个先进的数据高速缓存架构和内存管理功能,从而使授权厂商可以有效地移植保留其原有代码,并确保以更低的价格实现相同的DSP性能。

丰富的软件工具链

CEVA-X1643 DSP内核由CEVA-Toolbox软件开发、调试和优化环境所支持,仅通过使用标准C源代码即可实现接近最佳系统性能。CEVA-Toolbox包括应用优化器(Application Optimizer)工具,可让应用开发人员完全以C语言轻易开发软件,从而节省开发时间,省去手写汇编语言环节,进而显著改善总体性能,并缩短SoC的开发周期。例如,使用应用优化器在CEVA-X1643 DSP内核上实现自适应多速率窄带语音编解码(Adaptive Multi Rate-Narrow Band, AMR-NB)声音合成器,在初始编译时(即在最差的帧速和数据流状况下)仅需18 MHz性能。

供货

CEVA-X1643现可供授权使用,要了解更多的信息,请联络 sales@ceva-dsp.com,或联络中国区销售代表处,电话:021-6103-1719。

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